川大《数字电子技术2390》22春在线作业2[答案]
正确答案:B
《数字电子技术2390》22春在线作业2-00001
正确答案:A
试卷总分:100 得分:100
一、单选题 (共 20 道试题,共 40 分)
1.逻辑电路如图所示,当A=0,B=1时,{图}脉冲来到后{图}触发器( )。
{图}
A.具有计数(翻转)功能
B.保持原状态
C.置“0”
正确答案:A
正确答案:C
D.置“1”
正确答案:A
正确答案:C
2.{图}P
A.A
B.B
C.C
D.D
正确答案:C
3.某逻辑电路的真值表如下表所示,则该逻辑电路的最简与或表达式为( )。
{图}
A.{图}
B.{图}
C.{图}
D.{图}
正确答案:C
正确答案:B
4.{图}
A.会改变
B.不会改变
C.不能确定
D.有时改变,有时不改变。
正确答案:A
5.RAM芯片有11个地址输入端,8个数据输出端,该芯片的容量是( )。
A.211×8
B.28×11
C.88K
D.880
正确答案:B
6.如图所示逻辑电路为( )。
{图}
A.异步二进制加法计数器
B.同步二进制加法计数器
C.同步二进制减法计数器
D.异步二进制减法计数器
正确答案:D
7.{图}
A.具有计数(翻转)功能
B.保持原状态
C.置“0”
D.置“1”
8.逻辑图和输入A,B的波形如下图所示,输出F为“1”的时刻,应是( )。
正确答案:A
{图}
A.t1
B.t2
C.t3
D.无
正确答案:B
9.
A.0
B.1
C.Q
D.
正确答案:A
正确答案:B
10.{图}
A.{图}
B.{图}
C.{图}
D.{图}
11.七段显示译码器,当译码器七个输出端状态为abcdefg=0110011时(高电平有效),输入二进制代码为( )。
正确答案:C
A.0100
B.0110
C.0011
D.0111
正确答案:D
12.
A.A
B.
C.A+B
D.
13.引起组合逻辑电路竞争与冒险的原因是( )
A.逻辑关系错
B.干扰信号
C.电路延时
D.电源不稳定
正确答案:C
14.8421BCD码(01010010)转换为十进制数为( )。
正确答案:C
A.52
B.82
C.38
D.25
正确答案:B
15.下列描述不正确的是( )。
A.可编程器件FPGA只用于实现组合逻辑电路
B.寄存器、存储器均可用于存储数据
C.移位寄存器首尾相连可构成环形计数器
D.译码器、数据选择器、EPROM均可用于实现组合逻辑函数
正确答案:D
16.三变量函数{图}的最小项表示式中不含下列哪项( )。
A.m2 (正确答案)
正确答案:D
B.m5
C.m3
D.m7
正确答案:D
17.用555定时器构成单稳态触发器,其输出脉宽为()
A.0.7RC
B.1.1RC
C.1.4RC
D.1.8RC
正确答案:C
21.题面如下:
{图}
A.a
B.b
C.c
D.d
正确答案:A
19.单稳态触发器可作( )
A.产生正弦波
B.延时
C.构成D触发器
正确答案:C
正确答案:C
D.构成JK触发器
正确答案:D
20.{图}
A.正边沿T触发器
B.负边沿D触发器
C.负边沿T触发器
D.正边沿D触发器
正确答案:B
川大《数字电子技术2390》22春在线作业2[答案]多选题答案
正确答案:D
二、判断题 (共 15 道试题,共 60 分)
21.容量为256×4的存储器,每字4位,共计256字,1024个存储单元。
22.若要构成七进制计数器,最少用3个触发器,并且有1个无效状态。
23.在具有三组与输入端的与或非门中,当只使用其中的两组与输入端时,余下的一组与输入端应接高电平。对吗?
24.
25.二进制译码器相当于是一个最小项发生器,便于实现组合逻辑电路。
26.SR触发器、JK触发器均具有状态翻转功能。对吗?
27.当三态门输出为高阻时,其输出线上电压为高电平。
28.在二进制转换中,下列关系:(1001010100110001)B=(9531)H=(9531)8421BCD。对吗?
正确答案:B
29.二进制代码1000和二进制代码1001都可以表示十进制数9。对吗?
30.二进制的算术运算通常是转换成加法运算来完成的。对吗?
31.移位寄存器不仅可以寄存代码,而且可以实现数据的串-并行转换和处理。对吗?
32.二进制代码1000和二进制代码1001都可以表示十进制数9。
33.施密特触发器的特点是电路具有两个稳态且每个稳态需要相应的输入条件维持。对吗?
34.8421码(自然二进制码)和8421BCD码都是四位二进制代码。
正确答案:C
35.因为逻辑表达式A+B+AB=A+B成立,所以AB=0成立。
川大《数字电子技术2390》22春在线作业2[答案]历年参考题目如下:
《数字电子技术2390》19秋学期在线作业2
试卷总分:100 得分:100
一、单选题 (共 20 道试题,共 60 分)
1.连续异或2014个1的结果是( )。
A.0
B.1
C.不确定
D.逻辑关系错误
2.在下列( )的输入情况下,与非运算的结果等于逻辑0。
A.全部输入为1
B.任意输入为0
C.仅有一个输入为0
D.全部输入为0
3.函数化简后的结果是 ( )。
A.B+D
B.0
C.1
D.A+B
4.OC门在使用时必须在( )之间接一个电阻。
A.输出与电源
B.输出与地
C.输出与输入
D.输入与地
5.逻辑图和输入A,B的波形如下图所示,输出F为“1”的时刻,应是( )。
A.t2 和t3
B.t1 和t2
C.t3 和t2
D.t1 、t2 、t3
6.的多余项是( )。
A.CD
B.{图}
C.{图}
D.ABC
7.七段显示译码器,当译码器七个输出端状态为abcdefg=0110011时(高电平有效),输入二进制代码为( )。
A.0100
B.0110
C.0011
D.0111
8.半加器逻辑符号如图所示,当A=1,B=1时,C和S分别为( )。
A.C=1,S=0
B.C=0 S=0
C.C=0 S=1
D.C=1 S=1
9.8路数据分配器的地址输入端有( )个。
A.3
B.4
C.8
D.1
10.下列电路中不属于时序逻辑电路的是( )?。
A.只读存储器(ROM)
B.计数器
C.寄存器
D.分频器
11.满足的触发器是( )。
A.{图}
B.
C.
D.
12.下图电路由JK触发器及与非门构成,当输入I=1时,发现该电路若在K输入处以置0代替Qn,则电路性能( )。
A.会改变
B.不会改变
C.不能确定
D.有时改变,有时不改变。
13.触发器的状态转换图如下,则它是:( )
A.D触发器
B.SR触发器
C.JK触发器
D.T触发器
14.逻辑电路如图所示,当A=0,B=0时,{图}
A.保持原状态
B.具有计数功能
C.置“0”
D.置“1”
15.4位二进制减计数器的初始状态为1001,经过100个有效计数脉冲后,状态是( )。
A.0101
B.1101
C.1100
D.0100
16.4位移位寄存器构成的环形计数器的模M=( )。
A.4
B.8
C.16
D.6
17.一片容量为1k×4的存储器,其存储单元有( )个。
A.4096
B.1024
C.2048
D.1M
18.将三角波变换为矩形波,需选用:( )。
A.施密特触发器
B.多谐振荡器
C.双稳态触发器
D.单稳态触发器
19.555定时器不可以组成( )。
A.JK触发器
B.单稳态触发器
C.施密特触发器
D.多谐振荡器
20.A/D转换器中,转换时间最短的是( )。
A.并行比较型ADC
B.逐次比较型ADC
C.双积分型ADC
D.并行比较型ADC和双积分型ADC
二、判断题 (共 20 道试题,共 40 分)
21.在二进制代码中,有下列关系:(16)D =(10000)8421BCD。对吗?
22.在十六进制与十进制的转换中,FFH=256D。对吗?
23.8421码(自然二进制码)和8421BCD码都是四位二进制代码。对吗?
24.二进制代码1000和二进制代码1001都可以表示十进制数9。对吗?
25.TTL与非门与CMOS与非门的逻辑功能相同。对吗?
26.OD门的输出端可以并联运行,实现“线与”的逻辑关系。对吗?
27.在具有三组与输入端的与或非门中,当只使用其中的两组与输入端时,余下的一组与输入端应接高电平。对吗?
28.数字电路中最基本的运算电路是加法器。对吗?
29.逻辑函数的最简与或表达式不是唯一的。对吗?
30.正逻辑的与门是负逻辑的与非门。对吗?
31.普通编码器和优先编码器在某一时刻都只能输入一个有效的编码信号。对吗?
32.数值比较器在比较两个多位数的大小时,是按照从低位到高位的顺序逐位比较的。对吗?
33.基本SR锁存器电路只能由与非门组成,用或非门是不能实现的。对吗?
34.要改变触发器的状态,必须有CP脉冲的配合。对吗?
35.移位寄存器不仅可以寄存代码,而且可以实现数据的串-并行转换和处理。对吗?
36.若要构成七进制计数器,最少用3个触发器,并且有1个无效状态。对吗?
37.容量为256×4的存储器,每字4位,共计256字,1024个存储单元。对吗?
38.自激多谐振荡器不需外加触发信号,就能自动的输出矩形脉冲。对吗?
39.施密特触发器输入触发信号有效后状态翻转,之后可撤销输入信号,触发器保持新状态不变。对吗?
40.在VerilogHDL语言中,行为级描述方式的关键词是initial或always,always是无限循环语句。对吗?
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